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职位要求

　　1、可以根据芯片成本的考虑优化版图；
　　2、熟练地掌握verilog, 熟练地使用cadence或者synopsys的自动布局布线工具
　　3．可以独立地根据提供的综合以后的网表，完成500万及以上门级的数字电路布局布线工作，包括ram，cpu和第三方的IP；
　　4、可以根据系统要求完成扫描链的插入和boundary scan的工作；
　　5、可以做功耗分析和IR drop分析；
　　6、掌握dft和dfm的设计方法和流程；
　　7、掌握自动布局布线后的验证方法；
　　8、可以熟练地完成版图的sign off；
　　9、以对小的数字电路RTL进行综合和仿真；
　　10、有过上述1～9条内容相关的成功案例。

工作地点

　　北京市海淀区知春路27号量子芯座

　　1、吸引优秀人才加盟
　　2、将公司与员工利益融为一体
　　3、鼓舞员工士气